數字電路設計剛入門的小夥伴們一起沖啊
這篇文記錄一下學習路線
知識樹
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數電基礎
//康華光-數字電路基礎-教材
//西電-數字電路與系統設計-視訊課
點選進入MOOC
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模電基礎
//康華光-模拟電路基礎-教材
//非常不情願放上這個鬼,但是數字後端的話肯定要重視,先在這裡積灰吧(昨天筆試的一個公司數字IC崗考了快一半篇幅的模電,或許是版圖基礎,盡管過了,就很迷惑,我就會一道題,哈哈哈哈恍恍惚惚,碩士的話好像就有用到版圖,設計流程的一環,涉及到流片我就記住了哈哈哈,再說吧,該啃啃筆試題了,連筆試都過不了太紮心了,秋招0offer的小垃圾,雖然沒有怎麼投,但是學校的校招相關公司太少了,最近要多充點電)
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verilog hdl
//湯勇明搭建你的數字積木-書目
//EDA原理及Verilog HDL實作-書目
//下面的網站(電腦進,360浏覽器有點卡)可以練習最基本的邏輯門電路,組合邏輯和時序邏輯電路,不用自己寫端口,以解決問題的形式出現,寫完代碼後支援quarters和modelsim的功能仿真而不用下軟體,代碼正确則仿真success,錯誤則有mismatch;具體學習前輩(大佬,建議關注嘿嘿)參考第二個連結
HDLBITS網站
李銳博恩的HDL系列目錄頁
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C語言
//再去考一次計算機二級
(為什麼要學C呢,雖然在學校學過但是當時很應付就隻想不挂科,考過一次二級沒過,主要是沒好好學指針,最近看書發現有很多對比FPGA和C的語句,再去考一下或許可以幫助我對語言的了解)
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vivado/modelsim工具
//vivadoU系列
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tcl腳本
//沒想好,好像有userguide,之後有時間的話搞搞
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實驗
//兩個接口的實驗其實有被卡住,雖然有正确的版本,還是想自己做出來,等最近的小目标完成了再考慮重新做
//沒有必要教育訓練班,買一塊開發闆(我用黑金感覺還不錯,不過還沒有學相對厲害的東西比如千兆網,DDR)自己搞就行,先看一些小梅哥呀正點原子的課,應該b站有,像我就感覺,唉,心疼的要死,就算上了教育訓練班薪資也隻會是6-8k,再多的話要自己花好大的力氣,和碩士當然不可同日而語,不過我是真的還不太想做一個碩士來着,實驗室的水好深啊,我還不一定考得上,其實報教育訓練班的初衷吧還有一部分是覺得我找不到工作,不會寫論文(菜雞哭泣),其實吧,學長學姐都能做的事情我們肯定也能的
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器件基礎
//除了上面的模電,對于晶片内部應該也有了解,畢竟屬于硬體設計,但是大部頭的書又不太好啃,是以準備把這個的學習和筆面試的準備合在一起,然後下面的這本書我覺得看着還挺好讀的,涉及一小部分講FPGA
//FPGA深度解析
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level up
//有RTL設計基礎之後就應該學習時序的知識了,其實最近都在建造對FPGA設計的宏觀了解,在着手看這兩個東西
//FPGA深度解析 書目
//基于FPGA的數字信号處理 高亞軍 書目
包括基本數學運算(吹爆!有符号數無符号數講的好厲害)加減乘除cordic算法fir濾波器等等
//芯動力—硬體加速設計方法
點選進入芯動力MOOC
//前面那本是後面的西交老師的課的推薦讀物,靜态時序和亞穩态的内容是和課對接的,這個課程的靜态時序我看到兩個人推薦(其中一個是老石談芯,知乎,b站都有号),可能是我電腦的原因,反正高清是帶不動的,标清1倍速還好,和我一樣想看概要課件的話建議用電腦才好找到(自定義下載下傳)檔案的位置,手機找東西太難了,就算是百度給的路徑我都沒找到,一開始我是想列印的來着,假期的話很多慕課都會關掉,是以大家在正常上課時間進入就可以一直看
最近效率還行吧
2021/4/9更新 很久沒學習了,iic難産以及找工作被薪資打擊到,頹靡了一段時間,記錄繼續~畢竟不會的還很多,不怪公司開的低(fifo,ddr,ethernet,主要是ip使用,然後還沒有時序優化的經驗)
進階前人建議